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搜索资源 - High Speed Digital Design
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采用按时间抽选的基4原位算法和坐标旋转数字式计算机（CORDIC）算法实现了一个FFT实时谱分析系统。整个设计采用流水线工作方式，保证了系统的速度，避免了瓶劲的出现；整个系统采用FPGA实现，实验表明，该系统既有DSP器件实现的灵活性又有专用FFT芯片实现的高速数据吞吐能力，可以广泛地应用于数字信号处理的各个领域。-time selected by using the in-situ-4 algorithm and coordinate rotation digital computer (CO
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硬件设计指南(PDF格式)，主要包括：Low Voltage Interfaces；Grounding in Mixed Signal Systems；Digital Isolation Techniques； Power Supply Noise Reduction and Filtering； Dealing with High Speed Logic-Hardware Design Guide (PDF format), including : Low Voltage Interfaces
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本设计基于数字频率合成技术,采用正弦查找表实现波形产生.直接数字频率合成技术（DDS）是一种先进的电路结构，能在全数字下对输出信号频率进行精确而快速的控制，DDS技术还在解决输出信号频率增量选择方面具有很好的应用，DDS所产生的信号具有频率分辨率高、频率切换速度快、频率切换时相位连续、输出相位噪声低和可以产生任意波形等诸多优点。
文中介绍了DDS的基本原理，对DDS的质谱及其散杂抑制进行了分析。程序设计采用超高速硬件描述语言VHDL描述DDS,在此基础上设计了正弦波、三角波、方波等信号
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用VHDL 语言设计交通灯控制系统, 并在MAX+PLUS II 系统对FPGA/ CPLD 芯片进行下载, 由于生成的是集成化的数字电
路, 没有传统设计中的接线问题, 所以故障率低、可靠性高, 而且体积小。体现了EDA 技术在数字电路设计中的优越性。-The design method of traffic light control system by using Very- High- Speed Integrated Circuit Hardware Descr iption La
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如何改良USB接口的EMI和ESD设计。时下流行的USB2.0接口具有高达480Mbps的传输速率，并与传输速率为12Mbps的全速USB1.1和传输速率为1.5Mbps的低速USB1.0完全兼容。这使得数字图像器、扫描仪、视频会议摄像机等消费类产品可以与计算机进行高速、高性能的数据传输。另外值得一提的是，USB2.0的加强版USB OTG可以实现没有主机时设备与设备之间的数据传输。-How to improve the USB interface of EMI and ESD design.
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使用VHDL语言编写的简易数字存储示波器，用MAX+PlusII仿真验证。VHDL编写了采样、存储写、存储读和显示4个模块。采样使用ADC0809，存储器使用6264，显示使用DAC0832。-The design of the chip as a high-speed signal ADC0809 the A/D converter, SRAM6264 memory for data storage after sampling, DAC0832 chip as a signal of D/A
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数字系统与VHDL程序设计语言
非常高速硬件描述语言, 也就是一种硬件(数字电路)设计语言. 其最大特点是对电路的行为与结构进行高度抽象化规范化，并对设计进行模拟验证与综合优化，使分析和设计高度自动化。 -Digital systems with VHDL programming language very high speed hardware descr iption language, which is a hardware (digital circuit) design langu
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从分析FIR 数字滤波器的原理和设计方法入手,主要针对基于FPGA 实现数字滤波器乘法器的算法进行了比较研究,并通过一个8 阶FIR 低通滤波器的具体设计,简要分析比较了几种算法的优越性和缺点,从而充分发掘和利用FPGA 的高速特性。-From the analysis of FIR digital filter design theory and approach, mainly based on the realization of digital filter FPGA multiplie
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使用VHDL语言编写的简易数字存储示波器，用MAX+PlusII仿真验证。VHDL编写了采样、存储写、存储读和显示4个模块。采样使用ADC0809，存储器使用6264，显示使用DAC0832。-The design of the chip as a high-speed signal ADC0809 the A / D converter, SRAM6264 memory for data storage after sampling, DAC0832 chip as a signal of D
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This a PPT presentation named HSRA:High-Speed, Hierarchical Synchronous Reconfigurable Array (FPGA) prepared at the University of California at Berkeley. It gives a broad overview for beginners in the digital design with configurable logic.
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软件无线电技术是用于卫星导航和第三代移动通信(3G) 数据处理和计算的最优解决方案。运用基于FPGA的So PC 嵌入式设计方法构造软件无线电系统,提高了对动态实时信号的处理能力。设计完成无线通信体系结构,以及ADC 模数转换,数字下变频,CPU 中央处理器,DSP 运算单元,PCI 桥以及数据控制等模块的详细组成。相对于目前常规系统,该系统在功耗和体积方面可节省30 以上,对高速数据流的处理和计算能力有显著提高,可以应用于Cellular/ PCS 基站,GPS 抗干扰接收机,相控阵接收机,频
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以微处理器MPU为核心组成的通用微机系统；另一分支是发展面向对象的用于实时测控领域的微控制器 MCU，亦称单片微计算机（单片机）。随着超大规模高速集成电路的发展，现代电子技术的设计与应用进入了片上系统SOC（System On a Chip）阶段，从而使单片机的设计与应用技术发生了深刻的变化。SOC的设计要从整个系统的功能及性能出发，把微处理器（MPU）、芯片结构、数字/模拟等外围器件全部放置在一块芯片中，完成整个系统的功能，真正实现"系统单片机"。-Microprocessor MPU as
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本文首先研究可4一DQPsK调制解调系统中调制部分的基本原理和各个模块的设计方案，重点研究成形滤波器和直接数字频率合成器 (DireetoigitalFrequeneySynihesis，简称DDS)，并针对各个关键模块算法进行matlab设计仿真，展示仿真结果。其次，研究调制解调系统解调部分的基本原理和各个模块的设计方案，重点研究差分解调，数字下变频和位同步算法，也针对其各个关键模块进行算法的Matlab设计仿真。然后用Matlab对整个系统进行理论仿真，得出结论。在此基础
上，采用超高速
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vhdl语言集锦 VHDL是Very High Speed Integrated Circuit Hardware Descr iption Language的缩写,意思是超高速集成电路硬件描述语言。对于复杂的数字系统的设计,它有独特的作用。它的硬件描述能力强,能轻易的描述出硬件的结构和功能。这种语言的应用至少意味着两种重大的改变：电路的设计竟然可以通过文字描述的方式完成；电子电路可以当作文件一样来存储。随着现代技术的发展,这种语言的效益与作用日益明显,每年均能够以超过30 的速度快速成长。-V
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本设计利用人眼的“视觉暂留”效应，采用循环高速扫描的方式，分时轮流选通各数码管的COM端，使数码管轮流导通显示。-This design uses the human eye' s " persistence of vision" effect, with the way high-speed scanning cycle, time-gated turn the COM port of the digital control, digital control to tu
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近年来，基于FPGA的高速的模数转换器设计得到了广泛的应用。随着现代电子技术的应用和发展，越来越多的电子应用由模拟系统向数字系统转变，而AD转换器为模拟系统和数字系统的界面-In recent years, FPGA-based high-speed ADC design has been widely used. With modern electronic technology application and development, more and more electronic app
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介绍高速PCM-FM数字信号接收机的硬件平台设计与实现，主要应用芯片是3c120
-Introduce high-speed digital signal PCM-FM receiver hardware platform design and implementation, the main application chip is 3c120
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本设计利用人眼的“视觉暂留”效应，采用循环高速扫描的方式，分时轮流选通各数码管的COM端，使数码管轮流导通显示。-This design uses the human eye' s " persistence of vision" effect, with the way high-speed scanning cycle, time-gated turn the COM port of the digital control, digital control to tu
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本设计利用人眼的“视觉暂留”效应，采用循环高速扫描的方式，分时轮流选通各数码管的COM端，使数码管轮流导通显示。-This design uses the human eye' s " persistence of vision" effect, with the way high-speed scanning cycle, time-gated turn the COM port of the digital control, digital control to tu
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本文从高速数字信号处理器的特点、自适应滤波器的原理及主要应用领域入手，介绍了自适应滤波器的基本理论思想，具体阐述了自适应滤波器的基本原理、算法及设计方法。本文中，对两种最基本的自适应算法，即最小均方误差(LMS)算法和递归最小二乘（RLS)算法进行了详细的介绍和分析，并针对两种算法的优缺点进行了详细的比较。最后用DSP实现了自适应滤波器。实验结果表明，该自适应滤波器滤波效果优越。(Starting from the characteristics of high-speed digital si
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